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kinglin 发表于: 2008-11-21,
回复: 1
联想推出的5G存储空间免费网络硬盘, 数据永久有效。上传单个文件限制100M以内，可同时上传多个文件，支持断点续传，flash版在线上传，无需下载安装控件或软件。
把常用...
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0500240114 发表于: 2008-11-17,
哪位高手能给个4位2进制超前进位全加器的全定制版图参考下
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0500240114 发表于: 2008-11-16,
哪位大哥大姐能告诉我4位超前进位全加器在cadence里怎么仿真，怎么设定输入的信号，结果如何才算对？？？！！！！！
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flyfpga 发表于: 2008-09-24,
rom怎么仿真啊？我用的是modelsim6.1f和quartus7.2。有时提示：“Failed to open VHDL file "rom.hex" in rb mode ”；有时候提示No default binding for component at ...
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5life 发表于: 2008-09-05,
fsdbDumplimit - 限制FSDB文件size
-- $fsdbDumpvars(, *)
fsdbDumpfile - 指定FSDB文件名
-- $fsdbDumpfile(“”)
fsdbDumpvars - Dump指定的变量
--
fsdbD...
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dedekd 发表于: 2008-07-14,
回复: 3
我本科来自非重点院校，后来考上一所重点院校的牛导，不幸的是老板只让跟他做毕设的同学参与项目，我确实因为这个事情郁闷了很长时间，于是研二出去实习，后来老板在我的...
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hfly47 发表于: 2008-07-12,
也就是flatten的schematic，不是hierarchical的schematic。
如果可以，怎么实现？
谢谢！
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a1986498 发表于: 2008-07-08,
回复: 1
1主支干道交替通行，主干道每次放行30s，支干道每次放行20s.
2绿灯亮表示通行，红灯亮表示禁止通行。
3每次绿灯...
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wxk04 发表于: 2008-04-09,
最详细最实用 Orcad10
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wldjy 发表于: 2008-04-02,
回复: 3
同标题，谢谢。还望能给个实际例子，谢谢了！
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zhl_gs1980 发表于: 2008-03-27,
回复: 6
推荐一个射频通信，微波技术及IC设计类的非盈利论坛柏树塘学习网
柏树塘学习网是全心全意为广大通信、微波及IC设计专业的学生、教师、科研工作者提供...
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blackhyw 发表于: 2008-03-21,
:handshake 欢迎到人才版谈招聘求职职业咨询职场困惑..
(向21IC和edacn学习,把人气提上去)
内容如下：
1、职业发展方面的文章或个人感想
2、职业选择的困惑(公司...
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banneryu 发表于: 2008-03-10,
回复: 2
我用Design Compiler综合一个小例子（序列检测器seqdet.vg），想综合后在利用vcs查看仿真结果，但是编译一直编译不成功。主要是因为综合后生成的网表文件中有很多target...
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hy2018 发表于: 2008-01-27,
回复: 1
大家现在是不是都用verilog了呀，没人再用vhdl了吗？？
我是不是也应该改用了，跟下潮流
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EE0926 发表于: 2008-01-19,
回复: 1
请教各位高人一下，在ModelSim进行后仿时如何在testbench中引用网表中的内部变量，比如说用force命令进行强制赋值，或者说在wait语句中引用这个变量？
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loglong 发表于: 2007-12-25,
Hi, How to report timescale configuration for every module in vcs or other simulation tools. Thanks.
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yeyewowo 发表于: 2007-10-30,
用Nc-verilog仿真时，如何生成SAIF文件
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wldjy 发表于: 2007-10-06,
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新买的笔记本装得是Vista，用着挺好，其他常用的软件也都找到了与Vista兼容的版本，只是Modelsim一直没有，不想重新做成XP系统，请问哪个版本的Modelsim为Vista所兼容？...
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weikun 发表于: 2007-09-15,
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我在做一个项目的DSP的验证工作，用ModelSim仿真时遇到这样的情况：
** Error: clk_vbrx_i doesn't match!!!
# Time: 14825100 ps Iteration: 0 Instance: /d...
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mysee_liu 发表于: 2007-08-29,
回复: 1
请问在哪里有debussy下载啊
万分感谢啊